УЛУЧШЕННАЯ МОДЕЛЬ ДВУХЗАТВОРНОГО JFET ДЛЯ АНАЛОГОВЫХ ИНТЕГРАЛЬНЫХ МИКРОСХЕМ Текст научной статьи по специальности «Электротехника, электронная техника, информационные технологии»

(сс)

http://dx.doi.org/10.35596/1729-7648-2022-20-3-20-25

Оригинальная статья Original paper

УДК 621.382.322

УЛУЧШЕННАЯ МОДЕЛЬ ДВУХЗАТВОРНОГО JFET ДЛЯ АНАЛОГОВЫХ

ИНТЕГРАЛЬНЫХ МИКРОСХЕМ

3Минский научно-исследовательский приборостроительный институт (г. Минск, Республика Беларусь)

© Белорусский государственный университет информатики и радиоэлектроники, 2022

Аннотация. Двухзатворные полевые транзисторы с управляющим р-п-переходом часто применяются в аналоговых интегральных микросхемах для обеспечения предельно малого входного тока и емкости при управлении верхним затвором. Схемотехнический синтез и моделирование аналоговых микросхем с таким полевым транзистором возможны только при наличии моделей, адекватно описывающих особенности его работы, а именно - изменение вольт-амперных характеристик, управляя верхним затвором при подаче постоянного обратного напряжения на нижний затвор. В статье рассмотрена модернизация известной электрической модели двухзатворного полевого транзистора для программы LTSpice, заключающаяся в учете влияния напряжения на нижнем затворе путем включения в цепь верхнего затвора двух последовательно соединенных функциональных источников напряжения, один из которых обеспечивает совпадение результатов измерений и моделирования тока стока при малом напряжении между верхним затвором и истоком, а второй - при напряжении между верхним затвором и истоком, близком к напряжению отсечки. Приведена методика идентификации параметров функциональных источников напряжения. Предложенную модель двухзатворного полевого транзистора целесообразно использовать при схемотехническом проектировании различных аналоговых устройств, особенно электрометрических операционных усилителей и зарядочувствительных усилителей.

Ключевые слова: полевой транзистор с управляющим р-п-переходом, двухзатворный транзистор, электрическая модель, моделирование вольт-амперных характеристик.

Конфликт интересов. Авторы заявляют об отсутствии конфликта интересов.

Для цитирования. Галкин Я.Д., Дворников О.В., Чеховский В.А. Улучшенная модель двухзатворного ШЕТ для аналоговых интегральных микросхем. Доклады БГУИР. 2022; 20(3): 20-25.

Я Д. ГАЛКИН1- 2, О.В. ДВОРНИКОВ3, В.А. ЧЕХОВСКИЙ2

!Институт ядерных проблем Белорусского государственного университета (г. Минск, Республика Беларусь)

Поступила в редакцию 12 октября 2021

DOUBLE GATE JFET IMPROVED MODEL FOR ANALOG INTEGRATED CIRCUITS

YAROSLAV D. GALKIN1 2, OLEG V. DVORNIKOV3, VLADIMIR A. TCHEKHOVSKI2

^Belarusian State University of Informatics and Radioelectronics (Minsk, Republic of Belarus) 2Institute for Nuclear Problems of Belarusian State University (Minsk, Republic of Belarus)

3Minsk Research Instrument-Making Institute JSC (MNIPI JSC) (Minsk, Republic of Belarus)

Submitted 12 October 2021

© Belarusian State University of Informatics and Radioelectronics, 2022

Abstract. A double gate JFETs are often used in analog integrated circuits to provide an extremely low input current and capacitance when the top gate is controlled. Circuit synthesis and modeling of analog IC with such a field-effect transistor are possible only if there are models that adequately describe the features of its operation, namely, changing of the current-voltage characteristics by the top gate controlling when a constant reverse voltage is applied to the bottom gate. The article considers the modernization of the well-known electrical model of the double gate field-effect transistor for the LTSpice software, which includes taking into account the influence of the top gate voltage by connecting two series-connected functional voltage sources to the top gate, one of which ensures the coincidence of the measurement results and the simulation of the drain current at a low voltage between the top gate and the source, and the second - when the voltage between the top gate and the source is close to the cutoff voltage. A method for identifying the parameters of functional voltage sources is presented. The proposed model of a double gate field-effect transistor is advisable to use in the IC design of various analog devices, especially electrometric operational amplifiers and charge-sensitive amplifiers.

Keywords: junction field-effect transistor, double gate transistor, electric model, I-V characteristic simulation. Conflict of interests. The authors declare no conflict of interests.

For citation. Galkin Y.D., Dvornikov O.V., Tchekhovski V.A. Double Gate JFET Improved Model for Analog Integrated Circuits. Doklady BGUIR. 2022; 20(3): 20-25.

Введение

Двухзатворные полевые транзисторы с управляющим p-n-переходом (double gate junction field-effect transistor, DG JFET), формируемые на одной подложке с биполярными транзисторами (bipolar junction transistor, BJT) интегральных микросхем (ИМС), обычно имеют асимметричную структуру и обусловленные этим различные площади верхнего (top gate, TG) и нижнего (bottom gate, BG) затворов.

Меньшая площадь p-n-перехода и, следовательно, малая емкость и обратный ток верхнего затвора по сравнению с нижним в интегральных DG JFET используются в электрометрических операционных усилителях для обеспечения крайне малого входного тока на уровне десятков фемтоампер и большой полосы пропускания [1, 2]. Кроме того, применение паразитного BJT между верхним и нижним затворами позволяет оптимизировать параметры различных зарядочувствительных усилителей [3-5].

Для обеспечения схемотехнического синтеза новых высококачественных аналоговых ИМС авторами разработана конструкция DG JFET, совместимого с типовым технологическим маршрутом изготовления комплементарных интегральных BJT, изготовлены и исследованы экспериментальные образцы DG JFET, на основании результатов измерений предложена электрическая модель DG JFET для LTSpice и методика идентификации параметров [6, 7].

Созданная электрическая модель позволяет учесть особенности применения двухзатворного JFET в аналоговых микросхемах: управление соединенными затворами, управление верхним затвором с заданием постоянного напряжения на нижнем, использование

ДокладыБГУИР DoкLADY BGUIR Т. 20, № 3 (2022)_V. 20, N0. 3 (2022)

паразитного биполярного транзистора между верхним и нижним затворами, однако имеется погрешность в области малых токов стока.

Целью настоящей статьи является рассмотрение модернизированной модели DG JFET, более адекватно описывающей вольт-амперные характеристики (ВАХ) в области малых токов стока.

Сравнение известной и улучшенной модели двухзатворного JFET

Известная эквивалентная электрическая схема DG ^^ЕТ для программного обеспечения Ц^рюе приведена на рис. 1 [6], а на рис. 2 - предлагаемая улучшенная электрическая схема. Назначение всех элементов эквивалентной схемы и методики идентификации их параметров подробно рассмотрены в [6].

На схеме, показанной на рис. 1, применен источник напряжения, управляемый напряжением Е1, коэффициент передачи GAIN которого определяется из условия УТ1

GAIN =

thtgq

V

(1)

thbgq

где УщвО) - напряжение отсечки при управлении нижним затвором и напряжении между верхним

затвором и истоком VтGs = О В; УщЩ) - напряжение отсечки при управлении верхним затвором

и напряжении между нижним затвором и истоком VвGs = О В.

Как указывалось, в соответствии с результатами измерений У'тШц)/УтНщ) = 0,68,

но для лучшего совпадения результатов измерений и моделирования в широком диапазоне токов стока коэффициент передачи был выбран 0,79 [6].

Tg

C1

0.273p

C2_

2.252p

Q1

N

¿1

D1

B2

V=0.25*V(tg,s)

-Q-Q4-

B1

V=0.6835*V(bg,s)+0.0272

^Sub

Bg

Рис. 1. Эквивалентная электрическая схема

DG p-JFET в LTSpice Fig. 1. Equivalent electrical circuit DG p-JFET in LTSpice

Рис. 2. Улучшенная эквивалентная электрическая схема DG p-JFET Fig. 2. Advanced equivalent electrical circuit DG p-JFET

На схеме рис. 2 источник Е1 заменен на последовательное соединение функциональных источников напряжения В1 и В2 [8], причем выходное напряжение первого зависит от напряжения между нижним затвором и истоком, которое в соответствии с правилами LTSpice обозначено как V(bg,s), а выходное напряжение второго - от напряжения между верхним затвором и истоком V(tg,s).

Функциональная зависимость источника В1 найдена как аппроксимация экспериментальной зависимости напряжения верхнего затвора VтGso, обеспечивающего тот же ток стока, что и напряжение нижнего затвора VвGso (рис. 3), где VтGso = VтGs при VвGs = 0 В, VвGso = VвGs при VтGs = 0 В. Для рис. 3 получена зависимость у = 0,6835х + 0,0272 с величиной достоверности аппроксимации R2 = 0,9997.

На рис. 4 приведена экспериментальная ВАХ DG при управлении верхним

затвором VтGs и различном напряжении на нижнем VвGs, причем указаны численные значения

D

S

для наиболее важных точек ВАХ, а именно: максимального тока стока 1в.-мах = & при Утоя = 0 В и напряжения отсечки Ути = Утоя при ^ = 1 мкА.

VgsoV 5

ID, mA 0-

7 VgoV

Рис. 3. Экспериментальная зависимость

напряжения верхнего затвора Vtgs0, обеспечивающего тот же ток стока, что и напряжение нижнего затвора Vbgs0 Fig. 3. Experimental dependence of the top gate voltage Vtgs0, providing the same drain current as the bottom gate voltage Vbgs0

0 2.5 5.0 Vtgs, V

Рис. 4. Экспериментальная ВАХ DG ¿>-JFET при управлении верхним затвором: 1 - VBGS = 0 В,

2 - Vbgs = 1 В, 3 - Vbgs = 2 В, 4 - Vbgs = 3 В Fig. 4. Experimental I-V characteristic of DG p-JFET when the top gate is controlled: 1 - Vbgs = 0 V, 2 - Vbgs = 1 V, 3 - Vbgs = 2 V, 4 - Vbgs = 3 V

Введение источника В1 с предложенной аппроксимацией его выходного напряжения позволяет точно подстроить значения ^мах при разном Убоя, а изменением масштабирующего коэффициента источника В2 обеспечивается подстройка Ути также при разном Убоя.

Преимущества модернизированной модели по сравнению с исходной иллюстрируют рис. 5, 6, на которых приведено сравнение результатов измерений и моделирования ВАХ с использованием моделей на рис. 1, 2.

Анализ результатов, приведенных на рис. 6, позволяет утверждать, что применение эквивалентной электрической схемы, показанной на рис. 2, обеспечивает удовлетворительное моделирование ВАХ двухзатворного полевого транзистора в диапазоне напряжения Убоя от 1 до 3 В, что вполне достаточно для схемотехнического проектирования аналоговых схем.

Для адекватности модели в другом диапазоне напряжения Убоя необходимо уточнить масштабирующий коэффициент источника В2.

1

if

f

Id. mA

0

-10

0 1 2 3 4 5 Vtgs, V Рис. 5. Результаты измерений (точки) и моделирования (сплошная линия) ВАХ DG _p-JFET для модели рис. 1 при управлении верхним затвором: 1 - Vbgs = 1 В, 2 - Vbgs = 2 В, 3 - Vbgs = 3 В Fig. 5. Results of measurements (dots) and simulations (solid line) of I-V characteristics DG _p-JFET for fig. 1 model when top gate is controlled: 1 - Vbgs = 1 V, 2 - Vbgs = 2 V, 3 - Vbgs = 3 V

-10

5 Vtgs, V

Рис. 6. Результаты измерений (точки) и моделирования (сплошная линия) ВАХ DG p-JFET для модели рис. 2 при управлении верхним затвором: 1 - Vbgs = 1 В, 2 - Vbgs = 2 В, 3 - Vbgs = 3 В Fig. 6. Results of measurements (dots) and simulations (solid line) of I-V characteristics DG _p-JFET for fig. 2 model when top gate is controlled: 1 - Vbgs = 1 V, 2 - Vbgs = 2 V, 3 - Vbgs = 3 V

0

1

2

3

4

5

6

0

2

2

4

4

6

6

8

8

0

1

2

3

4

Заключение

Для схемотехнического проектирования предложена электрическая модель двухзатворного JFET, учитывающая особенности его включения в аналоговых микросхемах: управление соединенными затворами, управление верхним затвором с заданием постоянного напряжения на нижнем, использование паразитного биполярного транзистора между верхним и нижним затворами.

Повышение адекватности описания вольт-амперных характеристик двухзатворного JFET при управлении верхним затвором и при подаче постоянного обратного напряжения на нижний затвор достигнуто за счет включения в цепь верхнего затвора двух последовательно соединенных функциональных источников напряжения, один из которых обеспечивает совпадение результатов измерений и моделирования тока стока при малом напряжении между верхним затвором и истоком, а второй - при напряжении между верхним затвором и истоком, близком к напряжению отсечки.

Предложенную модель рекомендуется использовать при схемотехническом проектировании различных аналоговых микросхем, особенно электрометрических операционных усилителей и зарядочувствительных усилителей с входным двухзатворным JFET.

Список литературы

1. Close J.P., Counts L.W. A 50-fA junction-isolated operational amplifier. IEEE Journal of Solid - State Circuits. 1988;23(3):843-851. DOI: 10.1109/4.328.

2. Nanver L.K., Goudena E.J.G. Design considerations for integrated high-frequency p-channel JFETs. IEEE Transactions on Electron Devices. 1988;35(11):1924-1934. DOI: 10.1109/16.7406.

3. Fazzi A., Rehak P. «Gate-to-gate» BJT obtained from the double-gate input JFET to reset charge preamplifiers. Nuclear Instruments and Methods in Physics Research. 1996;A377:453-458. DOI: 10.1016/0168-9002(96)00238-0.

4. Fazzi A., Rehak P. A double-gate double-feedback JFET charge-sensitive preamplifier. Nuclear Instruments and Methods in Physics Research. 1996; A380(1-2):346-349. DOI: 10.1016/S0168-9002(96)00355-5.

5. Baturitsky M.A., Dvornikov O.V. The double-gate p-JFET-inputted amplifier for low-capacitance detectors. Nuclear Instruments and Methods in Physics Research. 1998;419(1):99-104. DOI: 10.1016/S0168-9002(98)00900-0.

6. Галкин Я.Д., Дворников О.В., Чеховский В.А., Прокопенко Н.Н. Экспериментальные исследования и модель двухзатворного JFET для аналоговых интегральных микросхем. Доклады БГУИР. 2021;19(7):5-12. DOI: 10.35596/1729-7648-2021-19-7-5-12.

7. Дворников О.В., Чеховский В.А., Прокопенко Н.Н., Галкин Я.Д., Кунц А.В., Чумаков В.Е. Проектирование аналоговых микросхем для экстремальных условий эксплуатации на основе базового матричного кристалла МН2ХА031. Проблемы разработки перспективных микро- и наноэлектронных систем (МЭС). 2021;1(2):37-46. DOI:10.31114/2078-7707-2021-2-37-46.

8. Володин В.Я. LTspice: компьютерное моделирование электронных схем. Санкт-Петербург: БХВ-Петербург; 2010.

References

1. Close J.P., Counts L.W.A 50-fA junction-isolated operational amplifier. IEEE Journal of Solid - State Circuits. 1988;23(3):843-851. DOI: 10.1109/4.328.

2. Nanver L.K., Goudena E. J. G. Design considerations for integrated high-frequency p-channel JFETs. IEEE Transactions on Electron Devices. 1988;35(11):1924-1934. DOI: 10.1109/16.7406.

3. Fazzi A., Rehak P. «Gate-to-gate» BJT obtained from the double-gate input JFET to reset charge preamplifiers. Nuclear Instruments and Methods in Physics Research. 1996;A377:453-458. DOI: https://doi.org/10.1016/0168-9002(96)00238-0.

4. Fazzi A., Rehak P. A double-gate double-feedback JFET charge-sensitive preamplifier. Nuclear Instruments and Methods in Physics Research. 1996; A380(1-2):346-349. DOI: 10.1016/S0168-9002(96)00355-5.

5. Baturitsky M.A., Dvornikov O.V. The double-gate p-JFET-inputted amplifier for low-capacitance detectors. Nuclear Instruments and Methods in Physics Research. 1998;419(1):99-104. DOI: 10.1016/S0168-9002(98)00900-0.

6. Galkin Y.D., Dvornikov O.V., Tchekhovski V.A., Prokopenko N.N. [Experimental studies and a double gate JFET model for analog integrated circuits]. Doklady BGUIR = Doklady BGUIR. 2021;19(7):5-12. DOI: 10.35596/1729-7648-2021-19-7-5-12. (In Russ.)

7. Dvornikov O.V., Tchekhovsky V.A., Prokopenko N.N., Galkin Y.D., Kunts A.V., Chumakov V.E. [Analog integrated circuits design for extreme environmental conditions on the base of master slice array MH2XA031]. Problemyrazrabotkiperspektivnyh mikro- i nanoelektronnyh sistem (MES). 2021;1(2):37-46. DOI: 10.31114/2078-7707-2021-2-37-46. (In Russ.)

8. Volodin VY. [LTspice: computer modeling electonic systems]. S.-Peterburg.: BHV-Peterburg; 2010. (In Russ.)

Галкин Я.Д. разработал модель двухзатворного транзистора, выполнил измерения ВАХ двухзатворных транзисторов и анализ полученных результатов.

Дворников О.В. выполнил анализ современного состояния проблемы по теме работы, сформулировал цель и задачи исследований, провел идентификацию параметров моделей.

Чеховский В.А. участвовал в разработке методик и измерениях параметров двухзатворных транзисторов.

Galkin Y.D. has designed the DG JFET model, carried out I-V measurements of DG JFET and analysis of obtained results.

Dvornikov O.V. has analyzed the current state of the problem, formulated the goals and objectives of the work and performed the identification of model parameters.

Tchekhovski V.A. has taken part in the design of methods and parameters measurements DG JFET.

Вклад авторов

Authors' contribution

Сведения об авторах

Information about the authors

Галкин Я.Д., аспирант Белорусского Galkin Y.D., Postgraduate at the Belarusian State

государственного университета информатики University of Informatics and Radioelectronics,

и радиоэлектроники, младший научный Junior Researcher at the Electronic Methods

сотрудник лаборатории электронных методов и and Experiment Means Laboratory of Research

средств эксперимента НИУ «Институт ядерных Institute for Nuclear Problems of Belarusian State

проблем» Белорусского государственного University.

университета.

Дворников О.В., д.т.н., доцент, главный Dvornikov O.V., Dr. of Sci., Associate Professor, Main

научный сотрудник ОАО «Минский научно- Researcher at the Minsk Research Instrument-Making

исследовательский приборостроительный Institute JSC. институт».

Чеховский В.А., заведующий лабораторией Tchekhovski V.A., Head of the "Electronic Methods

«Электронные методы и средства and Experiment Means Laboratory" of the Research

эксперимента» НИУ «Институт ядерных Institute for Nuclear Problems of Belarusian State

проблем» Белорусского государственного University.

университета.

Адрес для корреспонденции

Address for correspondence

220013, Республика Беларусь, г. Минск, ул. П. Бровки, 6, Белорусский государственный университет информатики и радиоэлектроники;

220013, Republic of Belarus, Minsk, P. Brovki St., 6, Belarusian State University of Informatics and Radioelectronics; tel. +375-257-250-775

тел. +375-257-250-775

e-mail: galkinyaroslav@gmail.com

Галкин Ярослав Денисович

e-mail: galkinyaroslav@gmail.com Galkin Yaroslav Denisovich